전공공부
전공과목을 서로 합치지 않고 과목별 허브와 12개 학습 단위로 정리합니다.
11 과목 · 4 개 글
Engineering Notes
전자전기공학 전공 공부와 설계·실습 과정을 자료, 코드, 회로, 파형, 측정 결과와 함께 정리한 글입니다.
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Taxonomy
전공과목을 서로 합치지 않고 과목별 허브와 12개 학습 단위로 정리합니다.
11 과목 · 4 개 글
VHDL·SystemVerilog 설계와 독립 reference model 기반 검증 기록입니다.
1 개 글
NUCLEO-F411RE 생체신호 prototype에서 ECG·PPG 회로, ADC·TIM1·USART2와 CMSIS-DSP 처리를 따라갑니다.
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판별형 CNN, Vision, 생성형 모델을 내가 공부한 순서대로 모았습니다.
12 개 글
회로도부터 PCB Library, Layout, DRC, Gerber까지의 설계 흐름입니다.
8 개 하위 페이지 · 1 개 글
TI mmWave 도구를 살펴본 뒤 FMCW 신호처리와 생체신호 정렬을 단계별로 공부했습니다.
8 개 하위 페이지 · 1 개 글
논문을 읽고 구현과 실험으로 이어 간 과정을 시간순으로 모았습니다.
1 개 글
Series
조합·순차회로와 self-checking testbench를 작은 설계 단위로 학습합니다.
동일한 cycle-delay contract를 여러 RTL 구조와 독립 checker로 비교합니다.
두 Raspberry Pi node가 sensing과 analysis를 나눠 처리하는 흐름을 prototype에서 따라갔습니다.
Dataset split과 metric 계산 조건을 확인한 뒤 PPG-HRV 분류 결과를 비교합니다.
데이터 탐색과 자동미분부터 CNN, 언어모델, RNN, BERT까지 Notebook에 남은 코드와 출력으로 다시 공부합니다.
생성모델 기초부터 Autoregressive Model, VAE, GAN, Pix2Pix, Diffusion까지 공부한 순서대로 정리합니다.
Logic·Library·Footprint·Layout·DRC·Gerber 흐름을 공개 가능한 사용자 산출물로만 구성합니다.
모터 모델과 H-Bridge를 먼저 살펴보고 전류·속도 이중루프와 saturation을 이어서 공부합니다.
전송선과 정합부터 Wilkinson·Branch-Line 회로의 저장된 Cadence 결과까지 차례로 살펴봅니다.
Chirp·Range FFT·phase에서 ECG 기준 beat alignment와 후보 시점 검증 경계까지 다룹니다.
Archive, rerun, redraw, release record를 공개 페이지에 정리합니다.
Latest
2026-08-10 · 연구 · 논문 · 프로젝트 기록 · Engineering Record Lineage 3
로컬 8765 포털에서 검증한 PCB inspection figure atlas와 lightbox 구성을 GitHub Pages 블로그와 프로젝트 허브에 다시 반영했습니다.
노트 읽기 →2026-08-01 · 전공공부 · DC Motor 제어 1
전동기제어 과제 보고서의 H-bridge, 전류·속도 이중루프와 스위칭 주파수 비교를 다시 읽고 정리한 기록.
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2026-08-01 · PADS · PCB 설계 · PADS PCB 설계 3
6-pin SOIC decal 치수와 OPA2333·filter·logic PPG 화면을 서로 다른 PADS 학습 사례로 정리한 기록.
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2026-08-01 · 전공공부 · RF · Microwave 3
Alumina microstrip 계산과 저장된 Cadence divider·hybrid 화면을 수치와 회로 구조로 다시 읽은 기록.
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2026-08-01 · 전공공부 · VHDL 디지털논리 기초 7
저장된 VHDL에서 overlapping 101 상태전이와 decoder 기반 MUX 구조를 다시 따라간 기록.
노트 읽기 →2026-08-01 · AI · Deep Learning · Computer Vision · 2024 OUTTA AI 부트캠프 Basic 6
Tokenization, attention mask, BERT output shape와 환경변수를 이용한 Gemini credential 처리를 코드 중심으로 정리했다.
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2026-08-01 · AI · Deep Learning · Computer Vision · 2024 OUTTA AI 부트캠프 Basic 5
Hidden state, sequence shape, train-test divergence와 Seq2Seq teacher forcing을 저장된 RNN 곡선으로 다시 정리했다.
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2026-08-01 · AI · Deep Learning · Computer Vision · 2024 OUTTA AI 부트캠프 Basic 4
TF-IDF cosine similarity에서 dense embedding과 autoencoder latent까지 표현 학습의 흐름을 정리했다.
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2026-08-01 · AI · Deep Learning · Computer Vision · 2024 OUTTA AI 부트캠프 Basic 3
Convolution과 pooling의 shape를 따라가고, 저장된 loss·accuracy·오분류 이미지를 함께 읽은 CNN 공부 기록이다.
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2026-08-01 · AI · Deep Learning · Computer Vision · 2024 OUTTA AI 부트캠프 Basic 2
Sigmoid basis로 함수를 근사하고 spiral data의 decision boundary를 학습하면서 신경망의 깊이와 학습 실패를 비교했다.
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2026-08-01 · AI · Deep Learning · Computer Vision · 2024 OUTTA AI 부트캠프 Basic 1
NBA 신체 측정값을 그려 보고, 손실곡면·경사하강법·정규화를 선형회귀 Notebook 출력과 함께 다시 정리했다.
노트 읽기 →2026-08-01 · AI · Deep Learning · Computer Vision · 2025 생성모델 집중과정 5
Forward noise, reverse denoising, latent space와 Transformer backbone을 한 흐름으로 정리한 기록.
노트 읽기 →2026-08-01 · AI · Deep Learning · Computer Vision · 2025 생성모델 집중과정 4
Generator·Discriminator의 교대학습과 Pix2Pix의 조건·L1 loss를 연결한 기록.
노트 읽기 →2026-08-01 · AI · Deep Learning · Computer Vision · 2025 생성모델 집중과정 3
Encoder가 평균과 분산을 예측하는 이유와 reconstruction·KL loss를 코드 흐름으로 정리한 기록.
노트 읽기 →2026-08-01 · AI · Deep Learning · Computer Vision · 2025 생성모델 집중과정 2
결합확률을 순서대로 풀고 teacher forcing, log-likelihood, cross entropy를 연결한 기록.
노트 읽기 →2026-08-01 · AI · Deep Learning · Computer Vision · 2025 생성모델 집중과정 1
판별모델과 생성모델을 비교하고 Tensor shape와 데이터 시각화를 먼저 확인한 기록.
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2026-08-01 · AI · Deep Learning · Computer Vision · CNN과 판별형 AI 3
Subject split, fold, preprocessing, confusion matrix와 paper-reported metric을 하나의 성능값으로 합치지 않는 기록.
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2026-08-01 · 전공공부 · Embedded Integration과 Data Path 1
PPG sensing node, Camera/EAR analysis node, TCP/IP, file IPC, GPIO, I2C LCD와 alarm 경계를 실제 prototype으로 정리한 기록.
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2026-08-01 · mmWave · FMCW Radar · FMCW Radar Signal Processing 4
ECG R-peak, SCG reference, FMCW phase morphology와 직접 판막 측정의 차이를 실제 BGT60TR13C 연구 흐름으로 정리한 기록.
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2026-08-01 · FPGA · RTL · Digital Verification · SystemVerilog Delay Logic와 DV 5
동일 interface contract, 독립 reference model, expected cycle과 26개 regression check로 RTL architecture를 비교한 기록.
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